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https://hdl.handle.net/10216/59620Full metadata record
| DC Field | Value | Language |
|---|---|---|
| dc.contributor | Araújo, Armando Luís Sousa | pt_PT |
| dc.contributor | Oliveira, Pedro | pt_PT |
| dc.contributor | Universidade do Porto. Faculdade de Engenharia | pt_PT |
| dc.creator | Duarte, André Filipe Caetano | pt_PT |
| dc.date | 2009 | pt_PT |
| dc.date.accessioned | 2013-03-29T03:34:47Z | - |
| dc.date.available | 2013-03-29T03:34:47Z | - |
| dc.date.issued | 2009 | - |
| dc.identifier | oai:digitool.fe.up.pt:57839 | pt_PT |
| dc.identifier.uri | http://hdl.handle.net/10216/59620 | - |
| dc.description | Tese de mestrado integrado. Engenharia Electrotécnica e de Computadores (Major Telecomunicações). Faculdade de Engenharia. Universidade do Porto. 2009 | pt_PT |
| dc.format | XIV, 122 p., 30 cm | pt_PT |
| dc.format.mimetype | application/pdf | pt_PT |
| dc.language | por | pt_PT |
| dc.relation | FEUP | pt_PT |
| dc.relation | SDI | pt_PT |
| dc.relation | RiFEUP | pt_PT |
| dc.rights | openAccess | pt_PT |
| dc.subject | Controlo de tensão | pt_PT |
| dc.subject | Controladores digitais | pt_PT |
| dc.subject | Verilog HDL - linguagem de descrição de hardware | pt_PT |
| dc.title | Design of a digital controller for a 2MHz step down converter | pt_PT |
| dc.type | Dissertação | pt_PT |
| dc.contributor.uporto | Faculdade de Engenharia | - |
| dc.identifier.doi | 10.34626/93da-2v71 | - |
| thesis.degree.grantor | Faculdade de Engenharia | - |
| thesis.degree.grantor | Universidade do Porto | - |
| thesis.degree.level | 1 | - |
| dc.identifier.isni | https://isni.org/isni/000000040392388X | - |
| dc.identifier.ror | https://ror.org/043pwc612 | - |
| Appears in Collections: | FEUP - Dissertação | |
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| File | Description | Size | Format | |
|---|---|---|---|---|
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