1. Repositório Aberto da Universidade do Porto
  2. FEUP - Faculdade de Engenharia
  3. FEUP - Dissertação
Please use this identifier to cite or link to this item: https://hdl.handle.net/10216/89186
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dc.creatorJorge Filipe Morais Neves
dc.date.accessioned2025-11-10T13:55:43Z-
dc.date.available2025-11-10T13:55:43Z-
dc.date.issued2016-07-22
dc.date.submitted2016-07-27
dc.identifier.othersigarra:170144
dc.identifier.urihttps://hdl.handle.net/10216/89186-
dc.descriptionUsando uma fpga e uma ferramenta de alto nível implementar blocos matemáticos que exploram paralelismo, método de pipeline deforma a obter desempenho mais rápido que o processador. Igualmente também se vai estudar o espaço de projeto para analisar diferentes implementações relacionado tamanho de mantissa e parte fracionaria em relação a precisão, tempo de execução, areá ocupada e taxa de transferência\debito de valores. (Pass-word site 1245)
dc.language.isopor
dc.rightsopenAccess
dc.subjectEngenharia electrotécnica, electrónica e informática
dc.subjectElectrical engineering, Electronic engineering, Information engineering
dc.titleOperadores especializados para cálculo em vírgula flutuante com FPGAs
dc.typeDissertação
dc.contributor.uportoFaculdade de Engenharia
dc.identifier.doi10.34626/gjpc-0569
dc.identifier.tid201309254
dc.subject.fosCiências da engenharia e tecnologias::Engenharia electrotécnica, electrónica e informática
dc.subject.fosEngineering and technology::Electrical engineering, Electronic engineering, Information engineering
thesis.degree.disciplineMestrado Integrado em Engenharia Electrotécnica e de Computadores
thesis.degree.grantorFaculdade de Engenharia
thesis.degree.grantorUniversidade do Porto
thesis.degree.level1
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